CCD delay line
- 基础释义 纠错
- 释义
电荷耦合延迟线;
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-
1、
Series in/ Parallel Out CCD Multi-Tapped Delay Line with a Tap Interval of N-Bit
隔N位一抽头的串入并出CCD多抽头延迟线
来源：互联网摘选 -
2、
An Aluminum Gate 100-Element CCD Analog Delay Line Fabricated by Use of Lift-off Technic
采用剥离技术的铝栅100位CCD模拟延迟线
来源：互联网摘选 -
3、
本文提出一种以多晶硅为辅助层的剥离技术，运用该技术已研制成功铝栅100位CCD模拟延迟线。
来源：互联网摘选
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